Architetture dei processori/Architettura Itanium 2: differenze tra le versioni

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Gian BOT (discussione | contributi)
m Bot: Correggo errori comuni (tramite La lista degli errori comuni V 1.1)
 
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Il processore dispone di tre tipi di cache:
*La cache L1 (on-chip) è divisa in 16 KByte KB per le istruzioni e 16 KByte KB per i dati, ognuna a 4 vie associative con linee a 32 byte;
*La cache L2 (on-chip) da 96 KByte KB è a 6 vie associative con linee a 64 byte;
*La cache L3 (off-chip, ma comunque nello stesso package) da 4 MByte MB è a 4 vie associative con linee a 64 byte.
 
È da notare che comunque la dimensione della cache varia a seconda del modello di Itanium 2.