Architetture dei processori: differenze tra le versioni

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Questo corso tratterà le architetture interne dei [[w:Microprocessore|microprocessori]] elencandone le principali unità funzionali con annessi vantaggi e svantaggi. Il corso non affronterà tutte le tipologie possibili essendo le molte architetture interne sviluppate nel corso degli anni, maggior parte delle quali senza successo commerciale o riservate ad applicazioni specializzate. Il corso affronterà le architetture dal punto di vista teorico non concentrandosi sui singoli aspetti implementativi che rendono l'architettura [[w:Architettura x86|X86]] diversa da quella [[w:PowerPC|PowerPC]] per esempio. L'attuale documento non affronterà altresì nello specifico come le singole unità funzionali vengano implementate dato che il corso è indirizzato agli Ingegneri Informatici. Informazioni più specifiche sulle singole unità vengono affrontate nei corsi di Ingegneria Elettronica.
 
*[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Definizione|Definizione]]
*[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Storia|Storia]]
*[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Set di istruzioni|Set di istruzioni]]
*[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Processore monolitico|Processore monolitico]]
**[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Unità di decodifica|Unità di decodifica]]
**[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Arithmetic Logic Unit|Arithmetic Logic Unit]]
**[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Floating Point Unit|Floating Point Unit]]
**[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Cache|Cache]]
**[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Pipeline|Pipeline]]
***[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Unità predizione salti|Unità predizione dei salti]]
**[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Memory Management Unit|Memory Management Unit]]
**[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Single Instruction Multiple Data|Single Instruction Multiple Data]]
*[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Processore superscalare|Processore superscalare]]
*[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Very Long Instruction Word|Very Long Instruction Word]]
*[[Wikiversità:Facoltà di Informatica/Architetture dei processori/Evoluzioni future|Evoluzioni future]]