Personal computer/Mapping/CPU: differenze tra le versioni

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L'8284 in base ai possibili segnali ''ready'' di ingresso deve generare un segnale di ''ready'' con la giusta temporizzazione.
 
Ipotizziamo di poter dividere tutti i dispositivi in due gruppi che richiedono rispettivamente 2 e 3 stati di wait per completare l'accesso. Per generare i due segnali di ''ready'' ''RDY1'' e ''RDY2'' utilizziamo uno ''shift register'' a n uscite ''Q0, Q1, ..., Qn'' con ingressi il segnale di ''CLK'' e ''AEN''. Lo shift register a partire dal primo clock successivo alla ricezione del segnale ''AENALE'' attiva l'uscita ''Q0'', al clock ancora successivo ''Q1'' e così via.
Per il nostro sistema i segnali utili sono ''Q2'' e ''Q3'' che andranno collegati all'8284 come ''RDY1'' e ''RDY2''.